cl是什么
发布网友
发布时间：2022-04-21 23:22
共1个回答
热心网友
时间：2022-07-16 12:50
latency）：为cas的延迟时间，这是纵向地址脉冲的反应时间，也是在一定频率下衡量支持不同规范的内存的重要标志之一。
内存负责向cpu提供运算所需的原始数据，而目前cpu运行速度超过内存数据传输速度很多，因此很多情况下cpu都需要等待内存提供数据，这就是常说的“cpu等待时间”。内存传输速度越慢，cpu等待时间就会越长，系统整体性能受到的影响就越大。因此，快速的内存是有效提升cpu效率和整机性能的关键之一。
在实际工作时，无论什么类型的内存，在数据被传输之前，传送方必须花费一定时间去等待传输请求的响应，通俗点说就是传输前传输双方必须要进行必要的通信，而这种就会造成传输的一定延迟时间。cl设置一定程度上反映出了该内存在cpu接到读取内存数据的指令后，到正式开始读取数据所需的等待时间。不难看出同频率的内存，cl设置低的更具有速度优势。
上面只是给大家建立一个基本的cl概念，而实际上内存延迟的基本因素绝对不止这些。内存延迟时间有个专门的术语叫“latency”。要形象的了解延迟，我们不妨把内存当成一个存储着数据的数组，或者一个excel表格，要确定每个数据的位置，每个数据都是以行和列编排序号来标示，在确定了行、列序号之后该数据就唯一了。内存工作时，在要读取或写入某数据，内存控制芯片会先把数据的列地址传送过去，这个ras信号（row
address
strobe，行地址信号）就被激活，而在转化到行数据前，需要经过几个执行周期，然后接下来cas信号（column
address
strobe，列地址信号）被激活。在ras信号和cas信号之间的几个执行周期就是ras-to-cas延迟时间。在cas信号被执行之后同样也需要几个执行周期。此执行周期在使用标准pc133的sdram大约是2到3个周期；而ddr
ram则是4到5个周期。在ddr中，真正的cas延迟时间则是2到2.5个执行周期。ras-to-cas的时间则视技术而定，大约是5到7个周期，这也是延迟的基本因素。
cl设置较低的内存具备更高的优势，这可以从总的延迟时间来表现。内存总的延迟时间有一个计算公式，总延迟时间=系统时钟周期×cl模式数+存取时间（tac）。首先来了解一下存取时间（tac）的概念，tac是access
time
from
clk的缩写，是指最大cas延迟时的最大数输入时钟，是以纳秒为单位的，与内存时钟周期是完全不同的概念，虽然都是以纳秒为单位。存取时间（tac）代表着读取、写入的时间，而时钟频率则代表内存的速度。
举个例子来计算一下总延迟时间，比如一条ddr333内存其存取时间为6ns，而其内存时钟周期为6ns（ddr内存时钟周期＝1x2/内存频率，ddr400内存频率为400，则可计算出其时钟周期为6ns）。我们在主板的bios中将其cl设置为2.5，则总的延迟时间＝6ns
x2.5＋6ns＝21ns，而如果cl设置为2，那么总的延迟时间＝6ns
x2＋6ns＝18
ns，就减少了3ns的时间。
从总的延迟时间来看，cl值的大小起到了很关键的作用。所以对系统要求高和喜欢超频的用户通常喜欢购买cl值较低的内存。目前各内存颗粒厂商除了从提高内存时钟频率来提高ddr的性能之外，已经考虑通过更进一步的降低cas延迟时间来提高内存性能。
不过，并不是说cl值越低性能就越好，因为其它的因素会影响这个数据。例如，新一代处理器的高速缓存较有效率，这表示处理器比较少地直接从内存读取数据。再者，列的数据会比较常被存取，所以ras-to-cas的发生几率也大，读取的时间也会增多。最后，有时会发生同时读取大量数据的情形，在这种情形下，相邻的内存数据会一次被读取出来，cas延迟时间只会发生一次。
选择购买内存时，最好选择同样cl设置的内存，因为不同速度的内存混插在系统内，系统会以较慢的速度来运行，也就是当cl2.5和cl2的内存同时插在主机内，系统会自动让两条内存都工作在cl2.5状态，造成资源浪费。
