verilog hdl语言编程的问题

发布网友发布时间：2023-07-27 00:25

共2个回答

热心网友时间：2024-12-11 19:00

5'h1:seg_r = 8'h89; //显示h
5'h2:seg_r = 8'h8c; //显示p

这两句的情况和

5'h1:seg_r = 8'hf9; //显示1
5'h2:seg_r = 8'ha4; //显示2

这两句重叠了~

一样的情况，显示2种结果，当然不能显示了。

5'h11:seg_r = 8'h89; //显示h
5'h12:seg_r = 8'h8c; //显示p

改成这样就好了

热心网友时间：2024-12-11 19:00

case 不是顺序执行的

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