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VHDL中进程PROCESS中只能定义变量,不能定义信号吗?
发布网友
发布时间:2022-04-28 17:03
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热心网友
时间:2022-06-19 21:01
是的,信号声明只能放在结构体的声明语句中,而不能放到进程体中。这是因为在VHDL中信号signal表示元件之间的连线,而变量variable只是借用仿真平台的内存暂时存放的数据。
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