脉冲干扰隔离门，看不懂电路图，希望有电路分析（尤其VD2）。如下图：
发布网友
发布时间：2022-05-15 13:38
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热心网友
时间：2023-10-25 11:13
第一次看到这种电路，我以实际元件为例分析如下：
这是两级串联，目的是增加门限电压。为了计算方便我以 CMOS 器件为例。TTL 器件输入端有电流加载在 1K 电阻上，计算麻烦些。
求静态参数，设 Ui 是高阻状态，即无信号时，根据 KCL 列方程：
Uo0 / 1 = (5 - 0.7 - Uo0) / 10 + (5 - 1.4 - Uo0) / 10
Uo0 = 0.66V
Ui0 = 1.4 + 0.66 ≈ 2V
Ui 有信号时：
Ui ≤ 2V ， Uo ≤ 0.66V 。
Ui ＞ 2V , Uo ＞ 0.66V 。
可见小于 2V 的干扰信号被电路抑制，信号稳定在低电平。
负载电阻 1K 是必须有的，否则 Uo 始终是高电平，电路无意义。
追问意思就是5V和10k是用来调节Uo0的，门限是1.4V+Uo0，看了你的KCL方程才明白，非常感谢。
热心网友
时间：2023-10-25 11:13
此图是利用普通二极管PN结导通阀值（硅型约0.7V，锗型约0.2V）来抑制小幅度干扰信号，假设都是硅型二极管，那么干扰信号小于1.4V时二极管是不会导通的，只有干扰信号大于1.4V以上时才会穿透二个二极管。追问非常感谢。大概明白了。
脉冲干扰隔离门,看不懂电路图,希望有电路分析(尤其VD2)。如下图:
可见小于 2V 的干扰信号被电路抑制，信号稳定在低电平。负载电阻 1K 是必须有的，否则 Uo 始终是高电平，电路无意义。
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